arm: Fix MVE vmlas encoding

Continuation of fix to VMLA

Bit 12 of the first halfword in the VMLAS instruction is listed as (0)
in the ARMARM (document DDI0553B.w, version ID07072023).
This means that the instruction does not discriminate between signed
and unsigned types and processing elements do not use the bit.
The encoding used by gas was based on an older version
of the document that made the sign important.
This change makes it possible to use vmlas.i8 (16,32) in addition to
vmlas.u8 and vmlas.s8 mnemonics, with the i8, i16 and i32 aliases becoming
the default when disassembling.
The generated encoding sets bit 12 to 0, compatibly with other
assembler implementations.

gas/config/tc-arm.c

diff --git a/gas/config/tc-arm.c b/gas/config/tc-arm.c
index fc93c2e..04bccaf 100644
--- a/gas/config/tc-arm.c
+++ b/gas/config/tc-arm.c
@@ -16032,7 +16032,7 @@
 {
   enum neon_shape rs = neon_select_shape (NS_QQR, NS_NULL);
   struct neon_type_el et
-    = neon_check_type (3, rs, N_EQK, N_EQK, N_SU_MVE | N_KEY);
+    = neon_check_type (3, rs, N_EQK, N_EQK, N_SU_MVE | N_I_MVE | N_KEY);
 
   if (inst.operands[2].reg == REG_PC)
     as_tsktsk (MVE_BAD_PC);
@@ -16044,7 +16044,7 @@
   else
     inst.pred_insn_type = MVE_OUTSIDE_PRED_INSN;
 
-  inst.instruction |= (et.type == NT_unsigned) << 28;
+  inst.instruction |= (et.type == NT_untyped) << 28;
   inst.instruction |= HI1 (inst.operands[0].reg) << 22;
   inst.instruction |= neon_logbits (et.size) << 20;
   inst.instruction |= LOW4 (inst.operands[1].reg) << 16;

gas/testsuite/gas/arm/mve-vmlas.d

diff --git a/gas/testsuite/gas/arm/mve-vmlas.d b/gas/testsuite/gas/arm/mve-vmlas.d
index 0e2ee15..df374da 100644
--- a/gas/testsuite/gas/arm/mve-vmlas.d
+++ b/gas/testsuite/gas/arm/mve-vmlas.d
@@ -5,1356 +5,2035 @@
 .*: +file format .*arm.*
 
 Disassembly of section .text:
-[^>]*> fe01 1e40 	vmlas.u8	q0, q0, r0
-[^>]*> fe01 1e41 	vmlas.u8	q0, q0, r1
-[^>]*> fe01 1e42 	vmlas.u8	q0, q0, r2
-[^>]*> fe01 1e44 	vmlas.u8	q0, q0, r4
-[^>]*> fe01 1e47 	vmlas.u8	q0, q0, r7
-[^>]*> fe01 1e48 	vmlas.u8	q0, q0, r8
-[^>]*> fe01 1e4a 	vmlas.u8	q0, q0, sl
-[^>]*> fe01 1e4c 	vmlas.u8	q0, q0, ip
-[^>]*> fe01 1e4e 	vmlas.u8	q0, q0, lr
-[^>]*> fe03 1e40 	vmlas.u8	q0, q1, r0
-[^>]*> fe03 1e41 	vmlas.u8	q0, q1, r1
-[^>]*> fe03 1e42 	vmlas.u8	q0, q1, r2
-[^>]*> fe03 1e44 	vmlas.u8	q0, q1, r4
-[^>]*> fe03 1e47 	vmlas.u8	q0, q1, r7
-[^>]*> fe03 1e48 	vmlas.u8	q0, q1, r8
-[^>]*> fe03 1e4a 	vmlas.u8	q0, q1, sl
-[^>]*> fe03 1e4c 	vmlas.u8	q0, q1, ip
-[^>]*> fe03 1e4e 	vmlas.u8	q0, q1, lr
-[^>]*> fe05 1e40 	vmlas.u8	q0, q2, r0
-[^>]*> fe05 1e41 	vmlas.u8	q0, q2, r1
-[^>]*> fe05 1e42 	vmlas.u8	q0, q2, r2
-[^>]*> fe05 1e44 	vmlas.u8	q0, q2, r4
-[^>]*> fe05 1e47 	vmlas.u8	q0, q2, r7
-[^>]*> fe05 1e48 	vmlas.u8	q0, q2, r8
-[^>]*> fe05 1e4a 	vmlas.u8	q0, q2, sl
-[^>]*> fe05 1e4c 	vmlas.u8	q0, q2, ip
-[^>]*> fe05 1e4e 	vmlas.u8	q0, q2, lr
-[^>]*> fe09 1e40 	vmlas.u8	q0, q4, r0
-[^>]*> fe09 1e41 	vmlas.u8	q0, q4, r1
-[^>]*> fe09 1e42 	vmlas.u8	q0, q4, r2
-[^>]*> fe09 1e44 	vmlas.u8	q0, q4, r4
-[^>]*> fe09 1e47 	vmlas.u8	q0, q4, r7
-[^>]*> fe09 1e48 	vmlas.u8	q0, q4, r8
-[^>]*> fe09 1e4a 	vmlas.u8	q0, q4, sl
-[^>]*> fe09 1e4c 	vmlas.u8	q0, q4, ip
-[^>]*> fe09 1e4e 	vmlas.u8	q0, q4, lr
-[^>]*> fe0f 1e40 	vmlas.u8	q0, q7, r0
-[^>]*> fe0f 1e41 	vmlas.u8	q0, q7, r1
-[^>]*> fe0f 1e42 	vmlas.u8	q0, q7, r2
-[^>]*> fe0f 1e44 	vmlas.u8	q0, q7, r4
-[^>]*> fe0f 1e47 	vmlas.u8	q0, q7, r7
-[^>]*> fe0f 1e48 	vmlas.u8	q0, q7, r8
-[^>]*> fe0f 1e4a 	vmlas.u8	q0, q7, sl
-[^>]*> fe0f 1e4c 	vmlas.u8	q0, q7, ip
-[^>]*> fe0f 1e4e 	vmlas.u8	q0, q7, lr
-[^>]*> fe01 3e40 	vmlas.u8	q1, q0, r0
-[^>]*> fe01 3e41 	vmlas.u8	q1, q0, r1
-[^>]*> fe01 3e42 	vmlas.u8	q1, q0, r2
-[^>]*> fe01 3e44 	vmlas.u8	q1, q0, r4
-[^>]*> fe01 3e47 	vmlas.u8	q1, q0, r7
-[^>]*> fe01 3e48 	vmlas.u8	q1, q0, r8
-[^>]*> fe01 3e4a 	vmlas.u8	q1, q0, sl
-[^>]*> fe01 3e4c 	vmlas.u8	q1, q0, ip
-[^>]*> fe01 3e4e 	vmlas.u8	q1, q0, lr
-[^>]*> fe03 3e40 	vmlas.u8	q1, q1, r0
-[^>]*> fe03 3e41 	vmlas.u8	q1, q1, r1
-[^>]*> fe03 3e42 	vmlas.u8	q1, q1, r2
-[^>]*> fe03 3e44 	vmlas.u8	q1, q1, r4
-[^>]*> fe03 3e47 	vmlas.u8	q1, q1, r7
-[^>]*> fe03 3e48 	vmlas.u8	q1, q1, r8
-[^>]*> fe03 3e4a 	vmlas.u8	q1, q1, sl
-[^>]*> fe03 3e4c 	vmlas.u8	q1, q1, ip
-[^>]*> fe03 3e4e 	vmlas.u8	q1, q1, lr
-[^>]*> fe05 3e40 	vmlas.u8	q1, q2, r0
-[^>]*> fe05 3e41 	vmlas.u8	q1, q2, r1
-[^>]*> fe05 3e42 	vmlas.u8	q1, q2, r2
-[^>]*> fe05 3e44 	vmlas.u8	q1, q2, r4
-[^>]*> fe05 3e47 	vmlas.u8	q1, q2, r7
-[^>]*> fe05 3e48 	vmlas.u8	q1, q2, r8
-[^>]*> fe05 3e4a 	vmlas.u8	q1, q2, sl
-[^>]*> fe05 3e4c 	vmlas.u8	q1, q2, ip
-[^>]*> fe05 3e4e 	vmlas.u8	q1, q2, lr
-[^>]*> fe09 3e40 	vmlas.u8	q1, q4, r0
-[^>]*> fe09 3e41 	vmlas.u8	q1, q4, r1
-[^>]*> fe09 3e42 	vmlas.u8	q1, q4, r2
-[^>]*> fe09 3e44 	vmlas.u8	q1, q4, r4
-[^>]*> fe09 3e47 	vmlas.u8	q1, q4, r7
-[^>]*> fe09 3e48 	vmlas.u8	q1, q4, r8
-[^>]*> fe09 3e4a 	vmlas.u8	q1, q4, sl
-[^>]*> fe09 3e4c 	vmlas.u8	q1, q4, ip
-[^>]*> fe09 3e4e 	vmlas.u8	q1, q4, lr
-[^>]*> fe0f 3e40 	vmlas.u8	q1, q7, r0
-[^>]*> fe0f 3e41 	vmlas.u8	q1, q7, r1
-[^>]*> fe0f 3e42 	vmlas.u8	q1, q7, r2
-[^>]*> fe0f 3e44 	vmlas.u8	q1, q7, r4
-[^>]*> fe0f 3e47 	vmlas.u8	q1, q7, r7
-[^>]*> fe0f 3e48 	vmlas.u8	q1, q7, r8
-[^>]*> fe0f 3e4a 	vmlas.u8	q1, q7, sl
-[^>]*> fe0f 3e4c 	vmlas.u8	q1, q7, ip
-[^>]*> fe0f 3e4e 	vmlas.u8	q1, q7, lr
-[^>]*> fe01 5e40 	vmlas.u8	q2, q0, r0
-[^>]*> fe01 5e41 	vmlas.u8	q2, q0, r1
-[^>]*> fe01 5e42 	vmlas.u8	q2, q0, r2
-[^>]*> fe01 5e44 	vmlas.u8	q2, q0, r4
-[^>]*> fe01 5e47 	vmlas.u8	q2, q0, r7
-[^>]*> fe01 5e48 	vmlas.u8	q2, q0, r8
-[^>]*> fe01 5e4a 	vmlas.u8	q2, q0, sl
-[^>]*> fe01 5e4c 	vmlas.u8	q2, q0, ip
-[^>]*> fe01 5e4e 	vmlas.u8	q2, q0, lr
-[^>]*> fe03 5e40 	vmlas.u8	q2, q1, r0
-[^>]*> fe03 5e41 	vmlas.u8	q2, q1, r1
-[^>]*> fe03 5e42 	vmlas.u8	q2, q1, r2
-[^>]*> fe03 5e44 	vmlas.u8	q2, q1, r4
-[^>]*> fe03 5e47 	vmlas.u8	q2, q1, r7
-[^>]*> fe03 5e48 	vmlas.u8	q2, q1, r8
-[^>]*> fe03 5e4a 	vmlas.u8	q2, q1, sl
-[^>]*> fe03 5e4c 	vmlas.u8	q2, q1, ip
-[^>]*> fe03 5e4e 	vmlas.u8	q2, q1, lr
-[^>]*> fe05 5e40 	vmlas.u8	q2, q2, r0
-[^>]*> fe05 5e41 	vmlas.u8	q2, q2, r1
-[^>]*> fe05 5e42 	vmlas.u8	q2, q2, r2
-[^>]*> fe05 5e44 	vmlas.u8	q2, q2, r4
-[^>]*> fe05 5e47 	vmlas.u8	q2, q2, r7
-[^>]*> fe05 5e48 	vmlas.u8	q2, q2, r8
-[^>]*> fe05 5e4a 	vmlas.u8	q2, q2, sl
-[^>]*> fe05 5e4c 	vmlas.u8	q2, q2, ip
-[^>]*> fe05 5e4e 	vmlas.u8	q2, q2, lr
-[^>]*> fe09 5e40 	vmlas.u8	q2, q4, r0
-[^>]*> fe09 5e41 	vmlas.u8	q2, q4, r1
-[^>]*> fe09 5e42 	vmlas.u8	q2, q4, r2
-[^>]*> fe09 5e44 	vmlas.u8	q2, q4, r4
-[^>]*> fe09 5e47 	vmlas.u8	q2, q4, r7
-[^>]*> fe09 5e48 	vmlas.u8	q2, q4, r8
-[^>]*> fe09 5e4a 	vmlas.u8	q2, q4, sl
-[^>]*> fe09 5e4c 	vmlas.u8	q2, q4, ip
-[^>]*> fe09 5e4e 	vmlas.u8	q2, q4, lr
-[^>]*> fe0f 5e40 	vmlas.u8	q2, q7, r0
-[^>]*> fe0f 5e41 	vmlas.u8	q2, q7, r1
-[^>]*> fe0f 5e42 	vmlas.u8	q2, q7, r2
-[^>]*> fe0f 5e44 	vmlas.u8	q2, q7, r4
-[^>]*> fe0f 5e47 	vmlas.u8	q2, q7, r7
-[^>]*> fe0f 5e48 	vmlas.u8	q2, q7, r8
-[^>]*> fe0f 5e4a 	vmlas.u8	q2, q7, sl
-[^>]*> fe0f 5e4c 	vmlas.u8	q2, q7, ip
-[^>]*> fe0f 5e4e 	vmlas.u8	q2, q7, lr
-[^>]*> fe01 9e40 	vmlas.u8	q4, q0, r0
-[^>]*> fe01 9e41 	vmlas.u8	q4, q0, r1
-[^>]*> fe01 9e42 	vmlas.u8	q4, q0, r2
-[^>]*> fe01 9e44 	vmlas.u8	q4, q0, r4
-[^>]*> fe01 9e47 	vmlas.u8	q4, q0, r7
-[^>]*> fe01 9e48 	vmlas.u8	q4, q0, r8
-[^>]*> fe01 9e4a 	vmlas.u8	q4, q0, sl
-[^>]*> fe01 9e4c 	vmlas.u8	q4, q0, ip
-[^>]*> fe01 9e4e 	vmlas.u8	q4, q0, lr
-[^>]*> fe03 9e40 	vmlas.u8	q4, q1, r0
-[^>]*> fe03 9e41 	vmlas.u8	q4, q1, r1
-[^>]*> fe03 9e42 	vmlas.u8	q4, q1, r2
-[^>]*> fe03 9e44 	vmlas.u8	q4, q1, r4
-[^>]*> fe03 9e47 	vmlas.u8	q4, q1, r7
-[^>]*> fe03 9e48 	vmlas.u8	q4, q1, r8
-[^>]*> fe03 9e4a 	vmlas.u8	q4, q1, sl
-[^>]*> fe03 9e4c 	vmlas.u8	q4, q1, ip
-[^>]*> fe03 9e4e 	vmlas.u8	q4, q1, lr
-[^>]*> fe05 9e40 	vmlas.u8	q4, q2, r0
-[^>]*> fe05 9e41 	vmlas.u8	q4, q2, r1
-[^>]*> fe05 9e42 	vmlas.u8	q4, q2, r2
-[^>]*> fe05 9e44 	vmlas.u8	q4, q2, r4
-[^>]*> fe05 9e47 	vmlas.u8	q4, q2, r7
-[^>]*> fe05 9e48 	vmlas.u8	q4, q2, r8
-[^>]*> fe05 9e4a 	vmlas.u8	q4, q2, sl
-[^>]*> fe05 9e4c 	vmlas.u8	q4, q2, ip
-[^>]*> fe05 9e4e 	vmlas.u8	q4, q2, lr
-[^>]*> fe09 9e40 	vmlas.u8	q4, q4, r0
-[^>]*> fe09 9e41 	vmlas.u8	q4, q4, r1
-[^>]*> fe09 9e42 	vmlas.u8	q4, q4, r2
-[^>]*> fe09 9e44 	vmlas.u8	q4, q4, r4
-[^>]*> fe09 9e47 	vmlas.u8	q4, q4, r7
-[^>]*> fe09 9e48 	vmlas.u8	q4, q4, r8
-[^>]*> fe09 9e4a 	vmlas.u8	q4, q4, sl
-[^>]*> fe09 9e4c 	vmlas.u8	q4, q4, ip
-[^>]*> fe09 9e4e 	vmlas.u8	q4, q4, lr
-[^>]*> fe0f 9e40 	vmlas.u8	q4, q7, r0
-[^>]*> fe0f 9e41 	vmlas.u8	q4, q7, r1
-[^>]*> fe0f 9e42 	vmlas.u8	q4, q7, r2
-[^>]*> fe0f 9e44 	vmlas.u8	q4, q7, r4
-[^>]*> fe0f 9e47 	vmlas.u8	q4, q7, r7
-[^>]*> fe0f 9e48 	vmlas.u8	q4, q7, r8
-[^>]*> fe0f 9e4a 	vmlas.u8	q4, q7, sl
-[^>]*> fe0f 9e4c 	vmlas.u8	q4, q7, ip
-[^>]*> fe0f 9e4e 	vmlas.u8	q4, q7, lr
-[^>]*> fe01 fe40 	vmlas.u8	q7, q0, r0
-[^>]*> fe01 fe41 	vmlas.u8	q7, q0, r1
-[^>]*> fe01 fe42 	vmlas.u8	q7, q0, r2
-[^>]*> fe01 fe44 	vmlas.u8	q7, q0, r4
-[^>]*> fe01 fe47 	vmlas.u8	q7, q0, r7
-[^>]*> fe01 fe48 	vmlas.u8	q7, q0, r8
-[^>]*> fe01 fe4a 	vmlas.u8	q7, q0, sl
-[^>]*> fe01 fe4c 	vmlas.u8	q7, q0, ip
-[^>]*> fe01 fe4e 	vmlas.u8	q7, q0, lr
-[^>]*> fe03 fe40 	vmlas.u8	q7, q1, r0
-[^>]*> fe03 fe41 	vmlas.u8	q7, q1, r1
-[^>]*> fe03 fe42 	vmlas.u8	q7, q1, r2
-[^>]*> fe03 fe44 	vmlas.u8	q7, q1, r4
-[^>]*> fe03 fe47 	vmlas.u8	q7, q1, r7
-[^>]*> fe03 fe48 	vmlas.u8	q7, q1, r8
-[^>]*> fe03 fe4a 	vmlas.u8	q7, q1, sl
-[^>]*> fe03 fe4c 	vmlas.u8	q7, q1, ip
-[^>]*> fe03 fe4e 	vmlas.u8	q7, q1, lr
-[^>]*> fe05 fe40 	vmlas.u8	q7, q2, r0
-[^>]*> fe05 fe41 	vmlas.u8	q7, q2, r1
-[^>]*> fe05 fe42 	vmlas.u8	q7, q2, r2
-[^>]*> fe05 fe44 	vmlas.u8	q7, q2, r4
-[^>]*> fe05 fe47 	vmlas.u8	q7, q2, r7
-[^>]*> fe05 fe48 	vmlas.u8	q7, q2, r8
-[^>]*> fe05 fe4a 	vmlas.u8	q7, q2, sl
-[^>]*> fe05 fe4c 	vmlas.u8	q7, q2, ip
-[^>]*> fe05 fe4e 	vmlas.u8	q7, q2, lr
-[^>]*> fe09 fe40 	vmlas.u8	q7, q4, r0
-[^>]*> fe09 fe41 	vmlas.u8	q7, q4, r1
-[^>]*> fe09 fe42 	vmlas.u8	q7, q4, r2
-[^>]*> fe09 fe44 	vmlas.u8	q7, q4, r4
-[^>]*> fe09 fe47 	vmlas.u8	q7, q4, r7
-[^>]*> fe09 fe48 	vmlas.u8	q7, q4, r8
-[^>]*> fe09 fe4a 	vmlas.u8	q7, q4, sl
-[^>]*> fe09 fe4c 	vmlas.u8	q7, q4, ip
-[^>]*> fe09 fe4e 	vmlas.u8	q7, q4, lr
-[^>]*> fe0f fe40 	vmlas.u8	q7, q7, r0
-[^>]*> fe0f fe41 	vmlas.u8	q7, q7, r1
-[^>]*> fe0f fe42 	vmlas.u8	q7, q7, r2
-[^>]*> fe0f fe44 	vmlas.u8	q7, q7, r4
-[^>]*> fe0f fe47 	vmlas.u8	q7, q7, r7
-[^>]*> fe0f fe48 	vmlas.u8	q7, q7, r8
-[^>]*> fe0f fe4a 	vmlas.u8	q7, q7, sl
-[^>]*> fe0f fe4c 	vmlas.u8	q7, q7, ip
-[^>]*> fe0f fe4e 	vmlas.u8	q7, q7, lr
-[^>]*> ee01 1e40 	vmlas.s8	q0, q0, r0
-[^>]*> ee01 1e41 	vmlas.s8	q0, q0, r1
-[^>]*> ee01 1e42 	vmlas.s8	q0, q0, r2
-[^>]*> ee01 1e44 	vmlas.s8	q0, q0, r4
-[^>]*> ee01 1e47 	vmlas.s8	q0, q0, r7
-[^>]*> ee01 1e48 	vmlas.s8	q0, q0, r8
-[^>]*> ee01 1e4a 	vmlas.s8	q0, q0, sl
-[^>]*> ee01 1e4c 	vmlas.s8	q0, q0, ip
-[^>]*> ee01 1e4e 	vmlas.s8	q0, q0, lr
-[^>]*> ee03 1e40 	vmlas.s8	q0, q1, r0
-[^>]*> ee03 1e41 	vmlas.s8	q0, q1, r1
-[^>]*> ee03 1e42 	vmlas.s8	q0, q1, r2
-[^>]*> ee03 1e44 	vmlas.s8	q0, q1, r4
-[^>]*> ee03 1e47 	vmlas.s8	q0, q1, r7
-[^>]*> ee03 1e48 	vmlas.s8	q0, q1, r8
-[^>]*> ee03 1e4a 	vmlas.s8	q0, q1, sl
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+[^>]*> ee05 fe40 	vmlas.i8	q7, q2, r0
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+[^>]*> ee19 1e47 	vmlas.i16	q0, q4, r7
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+[^>]*> ee1f 1e4a 	vmlas.i16	q0, q7, sl
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+[^>]*> ee29 3e44 	vmlas.i32	q1, q4, r4
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+[^>]*> ee29 3e48 	vmlas.i32	q1, q4, r8
+[^>]*> ee29 3e4a 	vmlas.i32	q1, q4, sl
+[^>]*> ee29 3e4c 	vmlas.i32	q1, q4, ip
+[^>]*> ee29 3e4e 	vmlas.i32	q1, q4, lr
+[^>]*> ee2f 3e40 	vmlas.i32	q1, q7, r0
+[^>]*> ee2f 3e41 	vmlas.i32	q1, q7, r1
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+[^>]*> ee2f 3e44 	vmlas.i32	q1, q7, r4
+[^>]*> ee2f 3e47 	vmlas.i32	q1, q7, r7
+[^>]*> ee2f 3e48 	vmlas.i32	q1, q7, r8
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+[^>]*> ee03 9e4c 	vmlas.i8	q4, q1, ip
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+[^>]*> ee05 9e48 	vmlas.i8	q4, q2, r8
+[^>]*> ee05 9e4a 	vmlas.i8	q4, q2, sl
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+[^>]*> ee2f fe4e 	vmlas.i32	q7, q7, lr
 [^>]*> fe71 8f4d 	vpste
-[^>]*> ee03 1e42 	vmlast.s8	q0, q1, r2
-[^>]*> fe1b 5e46 	vmlase.u16	q2, q5, r6
+[^>]*> ee03 1e42 	vmlast.i8	q0, q1, r2
+[^>]*> ee1b 5e46 	vmlase.i16	q2, q5, r6
+[^>]*> fe71 8f4d 	vpste
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gas/testsuite/gas/arm/mve-vmlas.s

diff --git a/gas/testsuite/gas/arm/mve-vmlas.s b/gas/testsuite/gas/arm/mve-vmlas.s
index 0d91bb3..90c1f75 100644
--- a/gas/testsuite/gas/arm/mve-vmlas.s
+++ b/gas/testsuite/gas/arm/mve-vmlas.s
@@ -1,6 +1,6 @@
 .syntax unified
 .thumb
-.irp data, u8, s8, u16, s16, u32, s32
+.irp data, u8, s8, u16, s16, u32, s32, i8, i16, i32
 .irp op1, q0, q1, q2, q4, q7
 .irp op2, q0, q1, q2, q4, q7
 .irp op3, r0, r1, r2, r4, r7, r8, r10, r12, r14
@@ -12,3 +12,9 @@
 vpste
 vmlast.s8 q0, q1, r2
 vmlase.u16 q2, q5, r6
+vpste
+vmlast.i8 q0, q1, r2
+vmlase.i8 q2, q5, r6
+
+@ bit 12 is ignored, should decode as vmlas.i8 q0, q0, r0
+.inst 0xfe011e40

opcodes/arm-dis.c

diff --git a/opcodes/arm-dis.c b/opcodes/arm-dis.c
index d4c1f24..aa8167d 100644
--- a/opcodes/arm-dis.c
+++ b/opcodes/arm-dis.c
@@ -2536,7 +2536,7 @@
   {ARM_FEATURE_CORE_HIGH (ARM_EXT2_MVE),
    MVE_VMLAS,
    0xee011e40, 0xef811f70,
-   "vmlas%v.%u%20-21s\t%13-15,22Q, %17-19,7Q, %0-3r"},
+   "vmlas%v.i%20-21s\t%13-15,22Q, %17-19,7Q, %0-3r"},
 
   /* Vector VRMLSLDAVH.  Note must appear before VMLSDAV due to instruction
      opcode aliasing.  */